微型计算机及接口技术

来源：继续教育 2023-07-18 15:33:33 点击数：次

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逻辑地址：分段后的段基址和偏移地址；表示形式为“段基址：偏移地址”物理地址：内存单元实际的20位地址。物理地址=段基址*10H 偏移地址

小端存储法：对于多字节数据，低字节放在低地址，高字节放在高地址多字节数据的地址：指最低字节的地址8086的工作方式：最小方式、最大方式最小方式：系统只有8086一个微处理器最大方式：系统中含有两个以上的主线总设备，8086为主处理器，其他为协处理器，8087、80898086工作方式由硬件决定，MN/MX接高电平，最小方式；接低电平，最大方式。

8086引脚：40引脚双列直插式封装。20根地址线、16根数据线、控制线、状态线、时钟线、电源线、地线8086最大方式和最小方式下公共引脚介绍：

（1）VCC电源， 5v电源

（2）AD15～AD0，地址/数据复用线，双向

（3）A9/S6～A16/S3，地址/状态复用线，输出；S6恒等0；S5=1，CPU响应可屏蔽中断；S5=0，禁止可屏蔽中断；S4、S3表明正在使用的段寄存器

（4）NMI，非屏蔽中断申请输入线，上升沿信号

（5）INTR，可屏蔽中断申请输入线，高电平有效

（6）clk，时钟输入线，连接时钟发生器8284，4.77MHz

（7）RESET，系统复位信号输入线；高电平有效，至少保持4个时钟周期；接通电源/按

RESET键，复位；复位状态，CS=FFFFH，IP、DS、ES、SS、FLAGS清零，指令对列清空； CS：IP=FFFFH ： 0000H，取指令

（8）READY，“准备好”信号输入线，高电平有效；内存或I/O设备发出；

（9）test，测试信号输入线，wait指令

（10）rd，读信号输出线，低电平有效，为地表明CPU正对内存或外设进行读操作

（11）MN/MX，最小/最大方式控制信号输入线

（12）BHE/S7，总线高允许/S7状态输出

最小方式下引脚介绍：

（1）INTA，中断响应信号输出线，低电平有效，若cpu响应外设中断申请，发出两个连续有效的INTA

（2）ALE，地址锁存允许信号输出线，高电平有效，对地址锁存器进行控制

（3）DEN，数据允许信号输出线，作为数据收发器的输出允许信号；DMA方式悬空

（4）DT/R，数据发送/接收信号输出线；控制数据总线收发器的传送方向；高电平，cpu向外发送数据，低电平cpu从外接收数据；DMA方式，置为浮空态

（5）M/IO，存储器/输入输出控制线，DMA方式浮空；高电平，cpu与内存进行数据传输；低电平，cpu与I/O端口进行数据传输

（6）WR，新信号输出线

（7）HOLD，总线保持请求信号输入线

（8）HLDA，总线保持响应信号输出线

最大方式下引脚介绍：地址总线和数据总线部分相同；控制总线部分有很大差别；最小方式下，控制总线从8086的到，无需外加电路；最大方式下，外加总线控制器8288

8086引脚与8088引脚不同之处：

（1）数据与地址的复用线：8086为16根（AD15～AD0），8088为8根（AD7～AD0）；（2）第28引脚，功能相同，有效电平不同：8086为M/IO（IO上有边个很短线），8088为M/IO（M上有边个很短线）；

（3）第34引脚：8086为BHE/S7，8088为SSO

时钟周期：计算机在时钟脉冲的统一控制下，一个节拍一个节拍地工作。这个时钟脉冲由时钟振荡器产生，每两个时钟脉冲上升沿至今的时间间隔称为T状态，或时钟周期。微处理器动作的最小时间单位。总线周期：cpu通过总线与存储器或输入/输出端口进行一次数据传输所要花费的时间称为一个总线周期。一个总线周期包含4个时钟周期。指令周期：执行一条指令所需的时间。不同指令的指令周期不同。

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